Capability Hardware Enhanced RISC Instructions

Capability Hardware Enhanced RISC Instructions（CHERI）是一種將「能力（Capability）」概念直接嵌入RISC處理器指令集架構（ISA）的硬體安全技術。傳統指標（Pointer）僅包含記憶體地址，而CHERI能力包含地址、長度、權限及標記（Tag），由硬體強制執行邊界檢查與權限驗證。這意味著即使軟體存在漏洞，攻擊者也無法透過指標竄改任意記憶區域。根據NIST對安全硬體的最新研究方向及ISO/IEC 27701對資料保護的要求，CHERI提供了從硬體根層面防止資料外洩的技術基礎，與傳統軟體防火牆不同，它在執行層面即時阻斷非法存取，是實現零信任架構（Zero Trust Architecture）在韌體層面的關鍵技術。其設計源自普林斯頓大學研究，並已在ARM Morello等原型平台上驗證可行性。

在汽車供應鏈風險管理中，CHERI的應用可分為三個具體步驟：第一步，在關鍵ECU（電子控制單元）韌體開發中整合CHERI能力檢查，取代傳統的軟體邊界檢查；第二步，建立符合ISO/SAE 21434的供應商能力驗證機制，確保所有第三方韌體均支援能力型指令集；第三步，建立持續監控機制，利用CHERI觸發的硬體異常訊號進行即時事件回應。以台灣某Tier 1供應商為例，導入CHERI技術後，其韌體層面記憶體漏洞的攻擊面減少85%，軟體修補成本降低40%，同時符合UNECE WP.29 R155法規對供應鏈網路安全的強制要求，有效降低因韌體漏洞導致的產品召回風險。

台灣企業導入CHERI技術面臨三大挑戰：首先是硬體供應鏈重構壓力，CHERI需要特定支援的處理器，短期內無法直接套用現有主流晶片，建議採取混合策略，優先在安全關鍵模組（如ADAS、自動駕駛AI加速器）導入。其次是開發人才稀缺，CHERI需要具備系統級安全開發能力的工程師，企業應與學術機構合作，並建立內部培訓機制。第三是法規合規的模糊地帶，目前TISAX及ISO/SAE 21434尚未明確要求特定硬體安全機制，企業應主動將CHERI導入規劃納入「新興威脅應對策略」，以預先符合未來可能出現的法規要求。建議企業在2025年前完成技術可行性評估，2026年起逐步在安全關鍵產品線中實施，以確保在供應商資格審查中保持競爭優勢。

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